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WSL2安装带有Tabnine自动补全功能的VimCreated: April 20, 2022 3:56 PMCreated By: Shane LiuLast Edited By: Shane LiuLast Edited Time: April 20, 2022 4:38 PM前言想在WSL2下写bug,但是Vim没补全,尝试了pydiction,不好用,连pytorch的语法都补全不...
最近在处理数据,需要画一下几个不同类别数据的统计特征图,因为类别以后可能会增加,所以作图就也没有写死,要跑个循环。不过最后想得到的效果是,每种数据在图上体现的形状是不一样的,暂时没想出来怎么做。于是去网上找了一些,Matlab论坛上有个老哥的想法很对头,记录一下。想法就是先把颜色和形状设置好,然后在循环中调用就可以了。x = randi(10,[5,10]); s = {'-*','-','...
UVM面经Phase机制简单来说就是不同时间做不同的事,把UVM仿真阶段层次化,build phase和fianl phase都是自上而下,其他事自下而上。除了run phase耗时是task phase,其他都是function phase。Run phase可以细分12个phase,run phase与细分的phase是并行的,但是12个phase是按照先后顺序来的。其中,run_pha...
第七章 UVM的寄存器模型寄存器模型简介带寄存器配置总线的DUT在本书以前所有的例子中,使用的DUT几乎都是基于2.2.1节中所示的最简单的DUT,只有一组数据输入输出口,而没有行为控制口,这样的DUT几乎是没有任何价值的。通常来说,DUT中会有一组控制端口,通过控制端口,可以配置DUT中的寄存器,DUT可以根据寄存器的值来改变其行为。这组控制端口就是寄存器配置总线。这样的DUT的一个示例如...
第五章 UVM验证平台的运行phase机制task phase与function phaseUVM中的phase,按照其是否消耗仿真时间($time打印出的时间)的特性,可以分成两大类,一类是function phase,如 build_phase、connect_phase等,这些phase都不耗费仿真时间,通过函数来实现;另外一类是task phase,如run_phase等,它们耗费 ...